
LogicVision社のEmbedded Test Solutionは大規模化・高集積化する
SoCのテスト設計からシリコンデバッグ、製造テストに至るフローを効率よく実行するためのソフトウェアツール群、チップに埋め込むIP、さらにはテスト関連エンジニアリングサービスを総合的に提供しています。
SoCのテスト設計からシリコンデバッグ、製造テストに至るフローを効率よく実行するためのソフトウェアツール群、チップに埋め込むIP、さらにはテスト関連エンジニアリングサービスを総合的に提供しています。

- ETLogicTM
- クロックドメイン数および周波数に依存しない真の実速度テストを実現するIPを自動生成し、組み込む製品です。
- フラットデザインへのBIST挿入を実現
- 階層別でもBIST挿入を実現することにより、大規模デザインへの対応容易化
- ETMemoryTM
- 組み込みメモリの実速度テストを実現するIPを自動で生成し、組み込む製品です。
- Hard Program: ユーザ独自のアルゴリズムをハードウェアとして提供いたします。
- Soft Program: チップ製造後に、ユーザ独自のアルゴリズムを自由に実現できます。
- Repair Analysis (Row & Column): 冗長ブロック付のメモリに対し、テスト終了後にリペア用の情報を即時に提供いたします。
- Build in Self Repair: LV社のIPが生成したリペア情報を元にチップ内での自動リペアを提供いたします。
- ETSerdesTM
- 高速差動シリアルインターフェース用のテストIPを自動生成し、組み込む製品です。
- ETBoundaryTM
- IEEE1149.1/1149.6に準拠したJTAG機能を実現するIPを自動生成し、組み込む製品です。
・BSDLファイル自動生成いたします
- ETAccessTM
- LV社のIPが組み込まれたチップの実速度診断をGUIを用いたインタラクティブな実行環境で提供いたします。

複雑なSoCに対して
テスト回路を自動挿入
メモリーとロジックへのアットスピードテスト・診断機能
ボードやシステムレベルでも製造工程と同様のテストを実現
インターネットもしくは無線によるリモート診断機能
EasyClusterTM3.4
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- 半導体/FPD製造装置の制御ソフトウェア・フレームワーク。
- 工場の自動化制御からプロセス制御まで可能。
- 半導体装置やLCD装置の制御を最適化。
- EasyClusterTM3.4の特徴
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- 制御システム構築が短期間に低コストで実現可能。
- エンジニアの技術習得が容易(C/C++)。
- アプリケーション開発も短期間で実現可能。
- ソフトウェアのメンテ、再利用が容易に可能。
- ハードウェアの分散/共有が可能。
- 体系化されたGUIとナビゲーションシステムが実現可能。

- EasyCluster 製品群
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- EasyCTC : クラスター・スケジューリング管理システム
- EasyTMC : 搬送モジュール管理システム
- EasyPMC : プロセスモジュール管理システム
- EasyGEM : ホストコミュニケーション管理システム(SECS/GEM)
- EasyRCS : リモートコントロール管理システム
- EasyEES : 装置データ収集、モニタリング等EES管理システム
Interface-AやTDIにも対応可能。

Nascentric社のOmegaSimTMは、大規模対応可能な、超高速、超高精度な次世代のRocket Fast SPICEシミュレータです。
アナログ/デジタル混在のシミュレータでマルチスレッド、マルチプロセッシングが可能です。
アナログ/デジタル混在のシミュレータでマルチスレッド、マルチプロセッシングが可能です。

- OmegaSimTMテクノロジ
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インテリジェント パーティショニング・オプティマイゼイション
マルチエンジンアーキテクチャー
マルチスレッド・マルチプロセッシング - Fast SPICEの限界
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全容量を考慮してのフルチップデザインの取り扱いが不可
→組み込みエンジンが130nmをターゲットにしているため
電流リーケージ測定における精度保持が不可
→電圧を評価することにより電流量を推測。タイミングのずれにより精度を不確保
実行速度の為に精度を犠牲
→デザイン毎にツールの実行条件を微調整し繰り返し実行が求められる

- OmegaSimTMアドバンテージ
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超高速 - 他のFast-SPICE製品の10Xのスピード
大規模対応 - フルチップ・マルチミリオントランジスタをネットリスト分割無しで全容量カバー
高精度 - ナノオーダーの精度をRocket Fast Speedで実現


ATopTech社のAprisaは、最新のパラレルコンピューティング技術を採用した、次世代デザインクロージャ・システムです。
その処理能力と使いやすい操作体系により、最先端プロセスでのデザイン課題を短TATで解決し、大規模なフラットレイアウト設計にも対応します。
その処理能力と使いやすい操作体系により、最先端プロセスでのデザイン課題を短TATで解決し、大規模なフラットレイアウト設計にも対応します。
- ネットリストからGDSまでの完全なソリューションを提供
- SI(ノイズグリッチ、クロストーク遅延)最適化の統合により、SI対応のマージンを不要にし、サインオフ解析の実行回数を削減
- 配線フェーズでも最適化を行うプレシジョン最適化手法により、より短TATで高品質なデザインクロージャを実現
- 簡素化されたメガコマンドフローによる理解のしやすさと、使いやすいGUIによる解析効率の向上で、フィージビリティ検証時間の大幅短縮
- マルチスレッド、マルチマシンでの分散処理を活用した超高速ソリューションは、少ないメモリでマルチシナリオ(MCMM)を同時に最適化、そして10Mゲートを越える大規模フラッレイアウト設計にも対応
- 既存環境への標準インターフェースを採用
APRISAの主要技術と効果









